Tukwila, la prossima generazione di cpu Itanium
Architettura a 4 core, con cache da 6 Mbytes per ogni cpu, quella della prossima generazione di cpu della famiglia Itanium
di Paolo Corsini pubblicata il 08 Maggio 2006, alle 08:59 nel canale ProcessoriStando alle informazioni pubblicate in questo articolo, la prossima generazione di processore Intel Itanium nome in codice Tukwila, integrerà 4 core di processore per ogni cpu fisica.
Per ogni core sarà presente una cache da ben 6 Mbytes di capacità; ogni processore integrerà un memory controller oltre ad una "next generation interconnect", che dovrebbe essere la tecnologia Common Systems Interconnect (CSI), approccio che dovrebbe essere simile a quello HyperTransport delle cpu AMD.
La tecnologia CSI dovrebbe venir implementata nelle cpu Tukwila con due link a piena ampiezza e due a mezza ampiezza, con un totale di 32 Gbytes di bandwidth a disposizione. CSI dovrebbe in seguito venir implementato anche in future generazioni di processore.
Il memory controller integrato dovrebbe supportare lo standard Fully Buffered Dimm (FB-Dimm) attraverso configurazioni a 4 o più canali. La tecnologia FB-Dimm è stata recentemente introdotta sul mercato da Intel con la più recente piattaforma per processori Xeon DP.
Il processore dovrebbe avere una frequenza di funzionamento di 2,5 GHz; ogni core permetterà di gestire sino ad un massimo di 2 threads, con quindi un totale di 8 threads per processore fisico che potranno essere gestiti contemporaneamente. Non è chiaro al momento se questa funzionalitò verrà implementata attraverso l'utilizzo della tecnologia HyperThreading o in altro modo.
Il debutto di Tukwila non è stato ancora ufficialmente indicato da Intel; secondo le informazioni della slide qui sopra riportata tale cpu non dovrebbe arrivare prima del 2008.
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20 Commenti
Gli autori dei commenti, e non la redazione, sono responsabili dei contenuti da loro inseriti - infoO cribbio
O cribbio 24MB Cache!!!!!
contando che ogni bit di cache ha bisogno di 6 transistor per essere implementato...24*1024*1024*8*6=1 miliardo 200 milioni e rotti di transistor!!
senza contare tutta la parte di indirizzamento..
Non vorrei sbagliarmi, ma mi pare che si siano delle dichiarazioni rilasciate da Intel un pò di tempo fa, in cui si rende noto che non vi è intenzione di integrare il memory controller nelle CPU desktop (e forse anche la serie Xeon) in quanto è ritenuta una scelta troppo vincolante.
OT
Con una tecnologia denominata CSI, era quanto meno DOVEROSO chiamare i core "Grissom"
/OT
Credo che Intel non passerà al memory controller integrato nelle CPU desktop almeno fino a quando sul mercato desktop non si vedrà una capillare diffusione delle FB-Dimm che permetterebbero di usare qualsiasi chip di RAM, siano essi DDR, DDR2 o DDR3.
Comunque ricordo che in passato si parlava di Itanium (IA64) per sistemi desktop e per motivi di software e costi non si sono mai diffusi, questo secondo me è un peccato
[OT]LOL! Core grissom...[/OT]
beh, se la news non fa nessun riferimento a variazioni nella micro-architettura e, soprattutto, se la nuova cpu si chiamerà sempre "itanium"...difficile pensare ad un modello di architettura ex novo, no ?
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