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#34421 |
Senior Member
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secondo me in questo caso hai ragione su tutto il discorso, semplicemente credo che per come sta andando il mercato ora abbiano più interesse a massimizzare il profitto offrendo un 8 core più prestante(che è un vantaggio per tutti i potenziali clienti/upgrade) che non una conta maggiore(che ad oggi è un vantaggio situazionale per utilizzi specifici) - data l'arch potrebbero fare entrambe le cose scalando in frequenza turbo a seconda dell'uso, ma all'aumento core corrisponde l'aumento di superficie che per loro credo non si sappia quale costo abbia ma che a parità di prezzo finale ridurrebbe il margine.
vediamo se al CES presentano qualcosa, poi c'è pure la grossa incognita frequenza perché se il pp permette di salire bene tra questo ed ipc potrebbero sfruttare tutto il tdp per boostare il più alto possibile se ci si ritrova sulle stesse frequenze anziché ridurre l'assorbimento avrebbe senso aumentare la conta e incentrare il marketing sulla potenza MT. Ultima modifica di Gioz : 29-11-2018 alle 09:53. |
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#34422 | |
Senior Member
Iscritto dal: Feb 2005
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#34423 | |
Senior Member
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#34424 |
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#34425 | |
Senior Member
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Per i CCX "esterni" che sono a 7nm, con il raddoppio di densità del 7nm, grossomodo da un wafer per ottenere lo stesso numero di core che si aveva sul 14nm, si dovrebbe arrivare sopra al 40% di fallati (il core Zen2 è più grosso) che ovviamente sarebbe disastroso. Per me ci sono ampi margini già per ipotizzare un costo inferiore/uguale a core... il problema è che con Intel che prezza alto, AMD potrebbe prezzare come vuole, anche un +50% a core.
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#34426 |
Bannato
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#34427 | |
Senior Member
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il pazzo è una persona che doveva togliere presto il materiale ![]()
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#34428 | |
Senior Member
Iscritto dal: Jun 2009
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spero che AMD piazzi in fascia media un processore che ha ottime prestazioni sul singolo core perchè avere tanti core e HT non è necessariamente utilissimo alla fetta di utenza che compra quei processori. |
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#34429 | |
Senior Member
Iscritto dal: Nov 2003
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Vedo però un nuovo bios (Update AGESA Code 1.0.0.6), quando ho un po di tempo provo ad aggiornarlo...
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#34430 | |
Senior Member
Iscritto dal: Feb 2005
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ma i chip dei core, anche a prescindere dalla resa, permetterebbero di marginare maggiormente se usati 1 per processore anziché 2 per processore (ammesso che ricorrano al medesimo design e non abbiano deciso di diversificare desktop e server); amd così avrebbe potenzialmente modo di offrire: prestazioni superiori delle 2 serie precedenti, continuando quindi a vendere e ottenere quote di mercato oltre ad offrire un upgrade come da annunci precedenti; volumi di produzione maggiori, e con lo shortage intel anche questo potrebbe dimostrarsi un vantaggio dal punto di vista del produttore, anche in ottica forniture OEM; non intendevo dare per scontato che fossero "limitati a dover fare degli 8 core perchè la resa non sia sufficiente" e non vorrei che passasse quella come mia impressione perché non ho alcuna idea delle possibili rese e faccio un ragionamento unicamente al pezzo; cioè, esempio banalissimo, se supponiamo di avere 10 pezzi e poterci fare 5 prodotti da 2 pezzi a 450€ vs 10 prodotti da 1 pezzo a 350€ è possibile che preferisca la seconda opzione. |
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#34431 |
Senior Member
Iscritto dal: Feb 2009
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nuova patch per Spectre riduce incredibilmente le prestazioni
https://www.lffl.org/2018/11/linux-4...h-spectre.html
L’ultima patch introdotta nel Linux 4.20 però, stando ai test condotti dai colleghi di Phoronix, è veramente molto pesante per il processore. La modifica riguarda gli “STIBP” o Single Thread Indirect Branch Predictors e riguarda solo le CPU Intel. Va a prevenire il controllo cross-hyperthread delle decisioni che sono prese dai branch predictors. In tutti e tre i test mostrati si nota che le CPU AMD non subiscono alcun impatto prestazionale, segno che la patch riguarda i processori INTEL. Ulteriori test, che trovate sul sito di Phoronix, raccontano di cali prestazionali nell’ordine del 30% anche per Python e PHP con la patch abilitata.
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#34432 |
Senior Member
Iscritto dal: Feb 2005
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credo intenda, almeno io ho capito così, che se il chiplet da 8 core è così piccolo e la resa fosse anche peggiore del 14nm, dovrebbe essere tragica per far marginare meno rispetto alle serie precedenti e che la "superficie grossa", il chip I/O a 14nm di rome, non entra in gioco direttamente nella "conversione" server-to-desktop aggravando il costo del prodotto.
io l'ho interpretato così, ma si sa che non lo capisco quasi mai ![]() |
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#34433 |
Senior Member
Iscritto dal: Jan 2002
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Io intendevo dire che i CCX sono fatti sul 7nm, e visto la densità doppia del 7nm, il prezzo a core deve essere comunque inferiore al 14nm. Il chiplet è fatto a 14nm, non è interessato allo yeld e quant'altro del 7nm.
Che poi AMD metta o meno il Chiplet nell'AM4, è relativo... cioè potrebbe fare varie combinazioni: Con Chiplet: Da un Chiplet Rome diminuisci le linee PCI, togli tutto l'MCM e poi cos'altro c'è? ok, 8 MC che devono rimanere 1, il controllo di parità l'ha pure AM4... e se ha la L3 da 256MB la porti a 32 o 16MB. Cioè, non è che deve riprogettarlo, lo deve semplicemente castrare. Alla fin fine diverrebbe grande quanto il die del CCX. Senza Chiplet: Partendo dal presupposto che AMD ha progettato il CCX Zen2 per tutto, Server, APU e desktop, praticamente potrebbe cambiare unicamente il film, cioè Epyc è quello, AM4 avrà il medesimo CCX a cui si potrebbe aggiungere il SOC e gli APU lo stesso schema CCX con l'aggiuta sul die della grafica e dell'interfacciamento. A mio parere... realizzare il Chiplet solo per server, sarebbe remunerativo? Perchè il prezzo è legato al volume, e se su 100 proci 1 è Epyc e 5 TR4, aggiungendo il volume AM4 il volume lo fai di certo, senza AM4 il volume sarebbe ridicolo... oltretutto considerando che AM4 senza Chiplet vorrebbe dire con SOC e quindi produzione 7nm. P.S. Ma uno schema tipo Chiplet, non potrebbe fare brodo in APU? Togliendoci l'MCM e le linee PCI in più, gli lasci 2 MC per avere un dual channel lato X86 e un dual channel lato iGPU, al posto della L3/L4 magari ci metti l'HBM2, ok il prezzo alto, ma se poi lo accoppi a un Zen2 X6 7nm e la iGPU corposa, si arriverebbe comunque a prestazioni difficilmente pareggiabili da soluzioni discreta esterna attuali. Io non vorrei sparare cacchiate, ma storicamente AMD fa come per il maiale, progetta 1 cosa e la ricicla in tutto. Un interfacciamento tipo Chiplet è indubbiamente complesso e mi sembra troppo impegnativo se utilizzato unicamente in Epyc. A me pare facente parte dell'architettura Zen2/Zen3 e applicato dovunque.
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#34434 | |
Bannato
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Quote:
![]() #eunagaranzia |
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#34435 |
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Tranquillo, domani si leggerà il classico "di meno del -5% e solo in sporadici casi di più". Ma riguarda antecedente l'i9 o è compreso?
Dico una battuta... AMD poteva risparmiarei soldi di incrementare l'IPC, ci pensa Intel da sola a decrementare il suo ![]()
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#34436 |
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ok, non avevo capito un razzo prima, appena ho tempo rileggo i post precedenti perchè probabilmente non ho frainteso il 90% di quanto hai scritto.
per chiplet si intende l'insieme di chip "base" che possono, in maniera modulare, essere combinati nel mcm per realizzare un soc rome complesso e non il solo chip I/O, mi sa che l'incomprensione è di carattere semantico/linguistico. |
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#34437 | |
Senior Member
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L'Epyc X32 Zen1 era come se 4 processori fossero uniti per farne 1. Zen2 + Chiplet a me da' l'idea di modulare... cioè il Chiplet può supportare fino a 8 die esterni che sarebbero i CCX con 8 core (da vedere se 1 CCX X8 o 2 CCX X4). L'introduzione del PCI4 è unicamente per avere una banda superiore del PCI 3. Ora... il chiplet sfrutta ciò che già Zen1 faceva, esempio TR4, cioè che esempio l'MC non deve obbligatoriamente essere accanto al core (l'X24 e X32 TR non sono esa channel e octa channel, ma sempre quad channel) ma possono accedere ai dati della L3 (che in Zen1 erano collegate con l'IF) e la lettura nelle DDR fatta da un MC X. Bene... se il chiplet avesse come si dice la L3, fondamentalmente è la L3 che si interfaccia con l'I/O (linee PCI, MC e quant'altro, direi come il SOC su AM4), quindi il processo arriverebbe alla L3 e senza importanza se viene dal 1° CCX o dal 2° e così via... perchè comunque tutto arriverebbe alla L3 che io considererei unificata. Ora... come ho scritto prima.... il Chiplet sarebbe un piatto servito per un APU, perchè AMD avendo la coesione sugli indirizzi X86/vga, praticamente ci puoi mettere n MC nel Chiplet, un L3 unica ed avere la banda che vuoi. Il Chiplet ovviamente è modulare anch'esso... perchè se un X64 avrà 256 linee PCI, 8 MC, 256MB di ram, ovviamente un X32 ne avrà la metà (128 linee PCI, 4 MC 128MB di L3, fino ad arrivare ad un Chiplet per X8 che avrebbe 32 linee PCI, 1 MC e 32MB di ram. Cioè, non possiamo guardare la dimensione del Chiplet di un X64 che oltretutto ha pure l'MCM e non valutare che per un X8 sarebbe 8 volte più piccolo. ------- Quando Lisa ha fatto vedere quell'X64, io mi sono guardato il die X8 di Zen1. se consideriamo i CCX completi di L3, tutto l'I/O sarà 1/10 del die e a sparare alto. Quell'X64 che ha fatto vedere Lisa,la dimensione del Chiplet è MOSTRUOSA... va bene che è a 14nm vs i die CCX che sono 7nm, ma quel coso anche se fatto a 7nm sarebbe grande quanto almeno 32 core... Se in Zen1 l'I/O era il 10%, come cacchio fa a passare al 50%? E' per questo che la teoria dei CCX senza L3 mi sembra esatta, perchè se nel Chiplet ci fosse la L3, la dimensione tornerebbe.
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#34438 | |
Senior Member
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quanto a modularità ci siam capiti, quella credo fosse l'unica cosa su cui probabilmente non ti avessi frainteso - resterà da vedere se faranno un design analogo a rome con un chip I/O ad hoc per le esigenze AM4 o se ripeteranno la scelta di un soc con tutto integrato a 7nm. |
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#34439 |
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#34440 |
Senior Member
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Magari, ma penso sia più un modo per mettere Intel sotto pressione, nel mobile lato driver AMD sta facendo vaccate, se non si smuove resta una nicchia dove non sfonda... I produttori che sono riusciti a sfornare modelli decenti sono davvero pochi, la maggior parte ha implementato male le soluzioni ryzen mobile, per limitare il TDP, più per il calore che per l'autonomia, e quindi Intel resta migliore su questi sistemi, anche se le ultime soluzioni fanno un po' pena
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