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#2461 |
Senior Member
Iscritto dal: Jul 2005
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buono?
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VENDO SAMSUNG I900 http://www.hwupgrade.it/forumshowthr...7#post34211007 |
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#2462 |
Senior Member
Iscritto dal: Jul 2007
Città: http://w-italia.miniville.fr
Messaggi: 7463
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inzomma...
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#2463 | |||
Senior Member
Iscritto dal: May 2004
Messaggi: 8345
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Da come la vedo io, quindi se vuoi prendila come la mia opinione personale, tutti per ovvie ragioni analizzano la reference board di AMD, poi ognuno può fare come crede; da quello che vedo, l'unica che segue molto fedelmente la reference board per il momento è la MSI: la sezione alimentazione è identica (a 5 stadi) e la disposizione dei chipset è la stessa (quindi non hanno cambiato nulla o quasi delle piste sul PCB), simili anche la disposizione degli innesti dell'alimentazione... Asus e Gigabyte hanno un disegno nuovo, diversa sezione alimentazione, diversa disposizione dei chipset e quindi delle piste sul PCB... lo stesso ha fatto DFI, diversificandosi ulteriormente soprattutto per la sezione alimentazione. Per me questo significa seguire o no la reference board, e ripeto, è come la vedo io. ![]() Quote:
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#2464 |
Senior Member
Iscritto dal: Feb 2006
Città: Aurisina (TS)
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#2465 |
Senior Member
Iscritto dal: Apr 2007
Messaggi: 1791
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Praticamente si sta dicendo che se amd non fà il botto subito siamo rovinati?
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#2466 | |
Senior Member
Iscritto dal: Oct 2002
Città: Mi
Messaggi: 8046
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bisogna vedere quanto i produttori di mobo am2 , abbiano voglia di spendere risorse nelle sviluppo dei bios per per far girare i phenom sulle vecchie mobo , visto che a loro fa più comodo piazzare le piattaforme am2+... |
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#2467 | |
Senior Member
Iscritto dal: Jul 2005
Città: Milano
Messaggi: 14007
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#2468 |
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#2469 |
Senior Member
Iscritto dal: Apr 2002
Messaggi: 1208
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Inutile fasciarsi la testa prima del tempo sul supporto ai Phenom per le mobo AM2.
Stiamo parlando di una cpu non ancora presente sul mercato, direi che è il caso di dare del tempo ai produttori per sviluppare dei bios adatti. ![]() Sulla volontà dei produttori di fornire il supporto tramite il rilascio di bios appositi, ci perdono di più in immagine a non fornirlo che in mancate vendite di schede madri. Siamo obiettivi, la percentuale di quelli che sostituiscono la cpu nel corso della vita utile del sistema nel mondo reale (escludendo gli appassionati tipo quelli presenti nei vari forum specializzati) è ad essere buoni inferiore all'1%. Perrdonatemi l'OT, ma se posso ritornare un attimo sul presunto punteggio record del Phenom 3.0Ghz al 3Dmark06 fatta da the Inquirer, l'attuale record mondiale è di 27039 punti ottenuti con un Core 2 Extreme Q6850 overcloccato a 5119Mhz, crossfire con 2 HD2900Xt overcloccate @ 1175/950MHz. The Inquirer avrebbe ottenuto 30.000 punti con Phenom 3.0Ghz a default e 2 HD2900Xt overcloccate 900@830. Oltre 10% meglio e con schede video molto meno tirate. Ok, non è certo ecc ecc, però..... Ultima modifica di overclock80 : 30-08-2007 alle 00:42. |
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#2470 |
Senior Member
Iscritto dal: Jan 2002
Messaggi: 2689
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boh a me il 3dmark non sembra un indice di misura affidabile per una cpu... semmai gpu... tra l'altro e' strano sotto vari aspetti quel 30k.
anche perche' se fosse vero che 3Ghz phenom va piu di 5Ghz core2 quad amd non avrebbe avuto molti motivi per ritardare cosi' tanto sti benedetti barcelona Ultima modifica di Braccop : 30-08-2007 alle 01:34. |
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#2471 | |
Senior Member
Iscritto dal: Feb 2005
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#2472 | |
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#2473 |
Senior Member
Iscritto dal: Feb 2006
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non è che non l'hanno tentato...ma il team che ha le 2 8800ultra sotto vapochill ha fatto meno delle 2 2900xt sempre sotto gas
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#2474 |
Senior Member
Iscritto dal: Jun 2003
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AMD Unveils SSE5 for Bulldozer Core
AMD today announced further plans to innovate the x86 architecture by introducing SSE5, a new extension of the x86 instruction set that is designed to allow software developers to simplify code and achieve greater efficiency for the most performance-hungry applications. SSE5 will give developers additional capabilities to help maximize the performance of applications that have daily impact on consumers and enterprises, including high performance computing, multimedia and security applications.
By making the SSE5 specification available to developers today, AMD expects to ease the adoption of the new instructions for tool providers and software vendors who develop these performance-intense applications. Chip advancements and software improvements go hand-in-hand, to the benefit of consumers and enterprises alike," said Phil Hester, senior vice president and chief technology officer, AMD. "The impact of our designs are best realized when AMD-based servers, PCs and devices enable software to more effectively solve every-day problems and enhance every-day experiences. By announcing our plans to add SSE5 instructions to the x86 instruction set -- and by making the specification available today -- we are enabling open and collaborative software innovation that will bring AMD's advancements to life for our customers and end-users." As the industry's focus is shifting from processor speeds to increasing power efficiency, the number of instructions executed per second on one processor core remains relatively constant. As a result, both software and hardware vendors must pursue new approaches to improving computing performance. AMD is once again helping advance this process by making technical details available to the software developer community early, to foster an industry dialogue and solicit feedback. For example, AMD released an early version of the AMD Virtualization(TM) specification in 2005, at the time codenamed "Pacifica," to the benefit of that technology's further development. Additionally, AMD recently released the Light-Weight Profiling proposal, which is designed to enable software developers to fully leverage the benefits of multi-core computing. The early release of the SSE5 specification to the software developer community follows AMD's philosophy of open collaboration, a model that effectively drove x86, 64-bit computing to the masses. "PGI's goal is to provide high-performance, cross-platform, production-quality parallel compilers and software development tools to the developer community," said Douglas Miles, director, The Portland Group. "We are working closely with AMD to enable developers to quickly and easily leverage the SSE5 instruction set to enhance high performance computing, and the multi-core and multi-media capability of their software applications." Multi-core processor technology and the integration of specialized co-processors are effective methods for extending performance limits. Equally important is enabling the ability to maximize the efficiency of each core by reducing the total number of instructions needed to achieve the same result. SSE5 helps maximize the output of each instruction and consolidates code base by introducing functionality previously only found in specialized, high-performance architectures, to the x86 platform: 3-Operand Instructions A computing instruction is executed by applying a mathematical or logical function to operands, or inputs. By increasing the number of operands an x86 instruction can handle from 2 to 3, SSE5 enables the consolidation of multiple, simple instructions into a single, more effective instruction. The ability to execute 3-Operand Instructions is currently only possible on certain RISC architectures. Fused Multiply Accumulate The 3-Operand Instruction capability enables the creation of new instructions which efficiently execute complex calculations. The Fused Multiply Accumulate instruction combines multiplication and addition to enable iterative calculations with one instruction. The simplification of the code enables rapid execution for more realistic graphics shading, rapid photographic rendering, spatialized audio, complex vector mathematics and other performance-intense applications. The SSE5 specification, which is being made available to the developer community today at http://developer.amd.com/SSE5, will be implemented in products based on AMD's next-generation "Bulldozer" core, available in 2009. http://developer.amd.com/assets/sse5...00_8-27-07.pdf |
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#2475 |
Bannato
Iscritto dal: Sep 2003
Città: Monza (Terrassa - Barcelona - España)
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#2476 | |
Senior Member
Iscritto dal: Apr 2005
Città: Napoli
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#2477 | |
Senior Member
Iscritto dal: Apr 2005
Città: Napoli
Messaggi: 6817
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![]() Ci sono tante istruzioni interessanti, istruzioni a 3 e 4 operandi, ecc... Il supporto al floating point a 16 bit è solo in lettura/conversione da e verso floating point a 32 bits... Nessuna operazione lavora con essa. Minimo 32 bit floating point... Però per come sono fatte le istruzioni si può leggere da memoria un tot di numeri FP16, farci operazioni, minimo a FP32 (ma anche a FP64) e riscrivere i risultati con conversione al volo, a gruppi di due (se si usano FP64) o 4 (se si usano FP32)... Non male... Resta sempre salva la possibilità di usare pipeline grafiche per fare i calcoli. In questo senso è interessante come AMD/ATI introdurrà i calcoli a 64 bit nelle prossime generazioni dopo R600: un passo gigante verso Fusion, perchè si apriranno le porte per dirottare TUTTE queste istruzioni (o almeno la maggior parte delle MMX, 3DNOW, SSEx, in particolare quelle che fanno i calcoli) sulle pipeline grafiche... ![]()
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#2478 | |
Senior Member
Iscritto dal: Mar 2006
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#2479 | |
Senior Member
Iscritto dal: Oct 2002
Città: Mi
Messaggi: 8046
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da quello che so quando un produttore sviluppa una mobo i costi dello sviluppo di un buon bios sono almeno pari ai costi della progettazione della mobo stessa.. , dunque ..ci anderei con i piedi di piombo , ovvio che mi auguro che escano dei buoni bios per phenom su mobo am2.. |
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#2480 |
Member
Iscritto dal: Oct 2002
Messaggi: 45
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http://www.vrforums.com/showthread.php?t=181755
E possibile con un tale resultato in 3DMark06 seppure a 3ghz, un tale resultate in SuperPi (2Ghz Barcelona). |
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