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17-01-2006, 23:39 | #641 | ||
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Che un Kernel tradizionale non giri ottimamente su una SPE (ma su 8??) è solo un limite che potrebbe essere superato con SO studiati appositamente. Questo lo vedremo tutti, piu' avanti. Quote:
Se poi vuoi dirmi che per lavorare bene necessitino della PPE, beh, questo sono mesi che lo sostengo anche io, cosi'come la PPE per lavorare bene necessita degli SPE. Come ci ha detto nAo che ci lavora, possono (volendo, ma perche' volerlo??) essre totalmente indipendenti. Anzi, ti diro' di piu', lavorando in streaming possono rivelarsi anche PPE limited (per ora, con codici non ottimizzati ed in taluni casi), dunque e' ovvio pensare che la loro possibilita' di lavorare indipendentemente sia e rarà discretamente utilizzata (come già accade infatti). Quanto al concetto di CPU, non fatemi scrivere mille volte le stesse cose. Un microprocessore e' una vastità di cose che non puo' essere definito in alcun modo "convenzionale", dunque se IBM parla di processore (o microprocessore) con differenze da uno convenzionale, intende chiaramente riferirsi ad una CPU standard.
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The PS3’s 8 parallel CPUs(one primary“PPU”and 7 Cell processors)..[ecc].Just about any tech programmer will tell you that the PS3’s CPUs are significantly more powerful. Qualche sapientino-doposcuola del forum, dovrebbe spiegare anche agli Insomniac, come è fatto il Cell e cosa sia uno SPE. lol |
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17-01-2006, 23:40 | #642 | |
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17-01-2006, 23:41 | #643 | |
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17-01-2006, 23:42 | #644 | |
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Una PPE o ciascuno dei 3 core dello xenon possono lavorare da soli. Un spe no. Conosco quei bench, ma non è che dicano molto; quelle della PPE non sono molto indicative come prestazioni di un'architettura altivec (ti ricordo che la ppe è di "derivazione" PPC). Tra l'altro, ti faccio notare come, all'aumentare del numero di spe impiegati, le prestazioni tendano ad appiattirsi (già a partire, praticamente, da 3 spe in poi). Poi, per carità, il mondo è bello perchè è vario; prendo mio nonno, gli consento un accesso alla memoria che tenga conto dell'arteriosclerosi, customizzo un SO in base al tasso di colesterolo e al diabete, e lo faccio funzionare come cpu del "sistema Casa". Ultima modifica di yossarian : 17-01-2006 alle 23:53. |
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17-01-2006, 23:49 | #645 | ||
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IBM lo definisce Cell, nel nome c'è la sua natura. Ogni processore (inteso come Cell intero o come elemento interno), puo' essere una cella o appartenere ad una. Duqnue e' seriale o parallelo a seconda di come si decide. Quote:
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17-01-2006, 23:55 | #646 | |
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Qui sbagli, volendo possono essere indipendenti (parola di IBM). Comunque non farmi difendere un qualcosa che poco sostengo, io li chiamo TUTTI processori, esattamente come fa IBM. La definizione di CPU a mio avviso, scemerà con il tempo. Come puoi leggere nei post successivi, ho detto anche che si puo' incappare in fenomeni di "PPE-limited", dunque l'ho notato eccome. Il fatto della VMX, l'ho detto solo perche' nell'atro thread, qualcuno paragonava gli SPE a delle VMX rivisitate. E chiaramente non e' esattamente la definizione piu' appropriata. Comunque sì, per ora 'sti bench vogliono dire poco.
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18-01-2006, 00:08 | #647 |
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"The PowerPC core present in the system is a general-purpose 64-bit PowerPC processor that handles the Cell BE's general-purpose workload (or, the operating system) and manages special-purpose workloads for the SPEs."
http://www-128.ibm.com/developerwork...y/pa-celldmas/ Le SPE non potranno essere mai indipendenti dalla PPE, almeno per come sono ora, in quanto il recupero delle eccezioni avvenute nelle SPE è demandato alla PPE... Sono indipendenti fra loro, ma non dalla PPE... |
18-01-2006, 00:13 | #648 | ||
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In quanto alla definizione "cpu", non vedo perchè debba perdersi. I sistemi multiprocessore non sono una novità, anzi, per essere pignoli, non lo sono neppure quelli multi-cpu. Ora, il fatto che si abbiano più processori sullo stesso die, non sposta di una virgola la cosa. Il cell non è destinato a rivoluzionare la terminologia informatica (e a detta di Mark Rein, l'evoluzione non va neppure in direzione degli stream processor). CPU ha un significato ben preciso, non applicabile ad un spe. Quote:
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18-01-2006, 00:22 | #649 |
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Secondo me questo 3d non finirà mai!
Giungerà il successore del cell ma sarete ancora quì a discutere di questa cosa ne sono certo!
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18-01-2006, 02:48 | #650 | |||||||
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Ed essere ideati per un qlc significa aspettarsi prestazioni decenti nel momento in cui il processore elabora quel tipo di dati. Come ho detto prima, la 500 su una pista di F1 ci và solo che ci mette n volte il tempo di una macchina da F1 e quindi si può dire senza problemi che NON è pensata per quel tipo di corse ( e nessun tipo di corse ). Faccio presente inoltre un'altra questione, forse puntigliosa ma IMHo significativa. Un prodotto può essere realizzato per un certo scopo, per un certo target, questo non significa poi che all'atto della commercializzazione e delle prove su strada si riveli efficiente/adatto a soddisfare le idee di partenza. Faccio un parallelo con un processore che ha, secondo me + di qlc in comune con il Cell. L'Itanium ( di cui tutti sanno la storia) nasce con l'intento di rivoluzionare il mondo dell'informatica, dal pdv dell'HW, dal pdv delle prestazioni ma dal pdv mi verrebbe da dire quasi filosofico, perchè l'obiettivo era in principio quello di costruire la CPU universale, adatta a qls scopo e per qls macchina. Gli obiettivi prefissati da Intel sn falliti miseramente e l'IA64 si è rivelata un'architettura molto performante per certi compiti, molto poco per tanti altri ( sui desktop n si è mai vista praticamente, nel calcolo degli interi è quanto mai debole così come lo è il Cell ed è stato surclassato dagli X86...è estremamente presente nei grossi cluster che eseguono simulazioni per es. metereologiche o cmq che si sobbarcano notevoli quantità di calcoli in floating point). Se vai a scartabellare i vari documenti tra white papers, drafts dell'Intel troverai svariati nomi o terminologie utilizzate per identificare l'itanium e l'IA64; sta di fatto che la pratica ha dimostrato che non è una CPU utilizzabile in un range elevato di campi se si vuole avere un rapporto costo/efficienza vantaggioso. Quote:
Su un'architettura penalizzata dall'esecuzione out-of-order e da accessi frequenti di tipo I/O, men che meno, non ha senso progettare programmi complessi e universali ( nel senso che fanno e permettono di svolgere n tipi di task differenti) come un SO. Sarebbe troppo costoso dal pdv della progettazione ( mi riferisco al lato SW) e non appagante in termini di prestazioni, tale da far perdere all'SO le caratteristiche intrinseche per es. di reattività o modularità... Se poi per kernel si intende il "subdivisional" kernel sviluppato per la GPU che sgrava la CPU in alcune fasi di elaborazione ( come la computazione di alcuni algoritmi e la parallellizzazione nel rendering delle varie mesh) ok è un kernel anche quello. Ma n credo lo vedrai mai utilizzato per farci girare un SO Quote:
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Gli Stati sn indipendenti ma poi nei fatti _dipendono_ da organizzazioni sovranazionali da cui n possono staccarsi per la sopravvivenza (economica) dello Stato stesso. Quote:
Ed in ogni caso l'indipendenza delle SPE è garantita dalla PPE. Per quanto riguarda limited o non limited io non ho ancora visto una riga di codice fatta girare su un Cell, quindi n saprei dire esattamente quando lo è, in che misura e in che tipo di elaborazioni...forse tu sì e quindi ne sai di + Quote:
Per CPU no, deve avere delle caratteristiche intrinseche che non sn imprescindibili, rivoluzione o meno che si ricerchi. ALU, MMU, protezione della memoria, set di istruzioni e via avanti... Quando IBM parla di SPE, dal nome stesso indica un'unità di elaborazione dedicata a compiti particolare, che non è quindi una CPU "standard" o "convenzionale" o "General Purpose" o come la vuoi chiamare. Non è una CPU. altrimenti l'avrebbero chiamate GPP non SPE. |
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18-01-2006, 03:40 | #651 | |
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18-01-2006, 03:45 | #652 | ||
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In ogni caso, se il futuro no e' streaming processor, bene, il Cell si chiama cosi' perche' funziona a celle, non lavorera' in streaming e via. Quote:
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18-01-2006, 03:46 | #653 | |
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18-01-2006, 04:27 | #654 | ||||||
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In ogni caso, io aspetterei (aspetto) i risultati concreti prima di parlare. La differenza tra me e te (e chi la pensa come te), sta nel mio non dare per assodate determinate questioni che potranno solo essere valutate con dei bench approfonditi. Quanto ad impressioni, beh, siamo tutti d'accordo, uno SPE non e' certamente il massimo per far girare Windows (uno a caso ). Quote:
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Ma tralasciamo questo dettaglio, andiamo al sodo.. "CPu vuol dire ..ecc. ha certi requisiti.. ecc.. non ha un vasto numero di significati come "microprocessore".. ariecc.." Dunque?? Aiutami tu a capire. Loro hanno detto che differisce da un microprocessore tradizionale per taluni fatti, dunque cosa e' un microprocessore "tradizionale"?? Non venirmi a dire un DSP, una VPU o simili, perché sai bene che non sta né incielo né in terra. Sono architetture ben differenti che non possono essere prese come puto di riferimento. Per tanto se quella frase non vuol dire ""Uno SPE, si differenzia da una CPU (o da un processore come PPE X86 ecc) convenzionale per le seguenti ragioni.. ecc." che altro puo' voler dire?? Non credo proprio vi siano altri significati. P.S. Cerca di non frammentare troppo i post!! Grazie.
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18-01-2006, 04:42 | #655 |
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Questo da arstechnica.com:
http://arstechnica.com/articles/paedia/cpu/cell-1.ars/2 The actual architecture of the Cell SPE is a dual-issue, statically scheduled SIMD processor with a large local storage (LS) area. In this respect, the individual SPUs are like very simple, PowerPC 601-era processors. The SPE's ISA, which is not VMX/Altivec-derivative (more on this below), includes instructions for using the DMA controller to move data between main memory and local storage. The end result is that each SPE is like a very small vector computer, with its own "CPU" and RAM. http://arstechnica.com/articles/paedia/cpu/cell-2.ars The basic architecture of the Cell is described by IBM as a "system on a chip" (SoC) design. This is a perfectly good characterization, but I'd take it even further and call Cell a "network on a chip." As I described yesterday, the Cell's eight SPUs are essentially full-blown vector "computers," insofar as they are fairly simple CPUs with their own local storage. Mi sento sempre meno visionario. Ci sono anche delle considerazioni riguardo il discorso del GP, lo consigilo a chi e' interessato all'argomento. Se non dovesse bastarvi nemmeno questo, che dirvi.. Mi arrendo!! Ma felice di essere in buona compagnia con il resto del mondo.
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18-01-2006, 08:29 | #656 | |
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Sinceramente quello che dicono altri siti non mi interessa...anche perchè credo che il livello di preparazione delle persone che ti hanno risposto in queste pagine sia veramente alto (e bada non solo uno ti ha dato ragione)...e di fatto le risposte sono autorevoli almeno quanto quello di un review di arstechnica (che per altro di castronerie ne ha scritte)... Comunque riguardo al primo quote da Arstechnica: The actual architecture of the Cell SPE is a dual-issue, statically scheduled SIMD processor with a large local storage (LS) area. In this respect, the individual SPUs are like very simple, PowerPC 601-era processors. Le SPE sono "simili a molto semplici" PowerPC 601...però ovviamente ci sono differenze notevoli: le SPE sono ottimizzate per il calcolo vettoriale e non sono processori indipendenti (tant'è che nei testi IBM vengono presentate come SIMD unit, Vector processor, ma mai come CPU)... The SPE's ISA, which is not VMX/Altivec-derivative (more on this below), includes instructions for using the DMA controller to move data between main memory and local storage. The end result is that each SPE is like a very small vector computer, with its own "CPU" and RAM. Che non fa che confermare la mia tesi...se le chiamano Vector Computer di fatto la definiscono una unità Special Purpose... Riguardo a "its own "CPU" and RAM": a parte che CPU è fra apici e già questo può far pensare "chiamo la SPU CPU, ma non sono CPU", ma il discorso che vogliono tirare fuori è che l'SPU svolge nelle SPE il ruolo che la CPU svolge all'interno di un computer... In pratica vendendo la SPE come un computer a sè stante (ma non lo è, ma come visione di insieme ci può stare) la SPU è pragonabile al ruolo centrale della CPU, e la Ram locale a quello della ram di sistema... Quindi niente a suffragare la tua tesi che le SPE siano CPU...visto che al massimo CPU possono essere definite le SPU, ma solo rispetto al sistema SPE... SPU che comunque non sono indipendenti dalla PPE... Stesso discorso per il secondo quote...il discorso è lo stesso che hanno tentato di fare sopra... Ultima modifica di cionci : 18-01-2006 alle 09:44. |
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18-01-2006, 09:32 | #657 | ||
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Comunque visto che la sospensione non t'è servita a molto e che continui a insultare e offendere la gente, la prossima volta chiederò una punizione esemplare nei tuoi confronti. Così magari tornerai a frequentare soltanto i tuoi "democraticissimi" forum coi tuoi amici moderatori che fanno il bello e il cattivo tempo, in barba ai regolamenti e alle stesse cose che scrivono.
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18-01-2006, 09:41 | #658 | ||
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18-01-2006, 09:51 | #659 |
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La Storia Infinita
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18-01-2006, 09:54 | #660 | |
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"The SPEs are independent processors, each running its own individual application programs. Each SPE has full access to coherent shared memory, including the memory-mapped I/O space. The designation synergistic for this processor was chosen carefully -- there is a mutual dependence between the PPE and the SPEs." Quindi le SPE possono eseguire programmi applicativi: in sostanza, delle normale applicazioni. NON dei s.o.. Tant'è nei documenti di IBM quando si parla di sistema operativo, non si fa mensione al fatto che possa girare su una SPE, ma al contrario, viene presentanto come qualcosa "al di fuori" delle SPE. A ciò aggiungiamo anche questo: "The SPUs are less complex computational units than PPEs, in that they do not perform any system management function. subject to any access properties set up by a PPE The IIC component manages the priority of the interrupts presented to the PPEs. Any SPU that encounters an illegal instruction immediately halts program execution, records the event in its status register, and requests an external interrupt. The illegal-instruction interrupt should be enabled and routed to a PPE. The exceptions also cause an exception interrupt to be generated and sent to a PPE. The SPU has the following restrictions: • No direct access to main storage (access to main storage using MFC facilities only) • No distinction between user mode and privileged state • No access to critical system control such as page-table entries (this restriction should be enforced by PPE privileged software). • No synchronization facilities for shared local storage access If the translation is not found in the hardware-accessed page table because of a page or mapping fault, a data storage interrupt (DSI) for the PPE or an interrupt for the SPE is posted to the PPE. Each SPE has a set of interrupt registers for masking the interrupting condition, holding the status of the interrupting conditions, and routing the interrupt to a PPE or other device in the system. an SPE interrupt condition causes an interrupt to be routed to a PPE or other device" Quindi le SPE non sono affatto indipendenti, checché tu ne dica: senza PPE non vanno da nessuna parte.
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