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11-05-2015, 00:27 | #29401 | |
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Comunque il supporto alle DX12 le avranno dalle APU Kaveri in su ma non cambierà di certo le prestazioni in maniera drastica... IL supporto alla GPU inattiva è un po uno specchietto per le allodole, ovvero si potrà fare ma resterà comunque una palla al piede per via della scarsa potenza e la scarsa banda della IGP...
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11-05-2015, 21:55 | #29402 | |
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le cpu pure basate sempre su zen chi sa come le chiameranno!? oltre a questo dite che permarrà dicitura fx oppure tenteranno di smacchiare la nomea nn eccellsa che permane agli occhi delle masse?.
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11-05-2015, 22:07 | #29403 | |
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12-05-2015, 11:31 | #29404 | |
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Ti riferisci a questa slide? http://s12.postimg.org/zct3f0uh9/AMDCPUPlatforms_M.jpg In effetti qui non si vede la scritta Zen sul settore APU... Quindi dovrebbero essere delle evoluzioni di Excavator, quindi sempre CMT, le APU di 7° gen.... In un certo senso la cosa mi incuriosisce molto. A sto punto sono davvero curioso di capire quanto sono scesi coi consumi con Carrizo...e quindi quando hanno reso efficiente l'architettura di BD dal punto perf/watt sul single thread (vero punto dolente di BD). Ovvio che si dovrà anche valutare le frequenze... me ne fregherebbe poco di avere dei moduli CMT che consumano 1watt in load...@1.5ghz. LOL Invece, altra possibilità drammatica...è che HSA non possa funzionare con un'architettura diversa dal CMT. E quindi siano costretti a portare avanti quel rottame di CMT anche nel 2016 e oltre...
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12-05-2015, 12:10 | #29405 | ||
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E probabile che usciranno APU e architettura ZEN nel 2017 con la nuova architettura GPU...
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12-05-2015, 13:29 | #29406 |
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mmmh...mah.. è possibile non siano in grado di integrare una GPU con HSA full nel core Zen.. altroché. (questo intendevo) Certo, dopo qualche tempo lo faranno.. ma è proprio questo che mi preoccupa. Sinceramente spero che il motivo sia che con Carrizo son riusciti a tirar fuori qualcosa di incredibile perf/watt per i 28nm e che quindi possano utilizzarlo con profitto anche nel 2016 col nuovo pp che darà un boost pazzesco lato perf/watt.
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12-05-2015, 13:33 | #29407 |
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Sicuramente si "sbatte" mooolto di meno a fare un Carrizo con supporto a ddr4, sul socket nuovo che a riprogettare l'apu in toto con zen sotto.
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12-05-2015, 14:11 | #29408 |
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Penso semplicemente che vedremo una situazione simile all'uscita di Llano e Bulldozer. L'APU con architettura precedente, e le CPU con la nuova architettura. In fondo lato APU, per il settore che devono coprire, l'architettura BD momentaneamente va piu che bene.
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12-05-2015, 14:20 | #29409 | ||
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AMD non ha specificato che la settima generazione fosse con il core ZEN ed è strano dato che per le CPU FX lo ha fatto in due slide; se le nuove APU fossero veramente con l'architettura ZEN non avrebbe senso non specificarla in roadmap. Il doppio controller DDR3/DDR4 era un (vecchio) rumors su Carrizo tuttavia dovrebbe essere utilizzata solo per il mobile tranne ovviamente compatibilità pin to pin con con l'infrastruttura FMx.. Quote:
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12-05-2015, 17:45 | #29410 |
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Quoto, le slide lasciano intendere che la prossima generazione di apu non equipaggerà il core Zen, presumibilmente ripiegando su Excavator (il che peraltro confermerebbe i leaks diffusi qualche tempo fa da sweclockers.com relativi al progetto Bristol Ridge. Qualora anche le specifiche per la piattaforma Summit Ridge di 8 core Zen (+SMT) con 95W TDP venissero confermate, avremmo buone probabilità di trovarci di fronte un bel mostriciattolo).
Ultima modifica di plainsong : 12-05-2015 alle 17:51. |
12-05-2015, 21:28 | #29411 |
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Anche questo è vero.
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13-05-2015, 09:29 | #29412 | |
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AMD in questi anni ha spinto gli APU nè più nè meno perchè il prodotto con le possibilità silicio e CMT + IGP è più che valido, specie nei 45W/65W dove il 28nm Bulk GF ha una resa migliore. SE a sto punto AMD butterà fuori la nuova architettura ma non come APU ma come FX, vorrebbe dire che darebbe la priorità al settore server e di qui desktop, ma è ovvio che per puntare questo, cioè potenze alte, DEVE avere un rapporto prestazioni/consumo ottimo, è ovvio che questo lo si avrebbe con il silicio e di qui dal rapporto PP e miniaturizzazione.
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17-05-2015, 12:53 | #29413 |
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Vorrei aggiungere una cosa alle mie speculazioni circa la L2 inclusiva e aumento di IPC.
Tempo addietro si era appresa una notizia circa un die nativo 16 core Zen ed unendo questo alle supposizioni di gestione di 2 TH a core, mi sembra palese che AMD non credo che pensi ad un 16 core 32 TH come base di un die nativo... Se le info sulla L2 che passa da esclusiva a inclusiva e della L3 che rimane esclusiva fossero vere, è naturale che non si possa pensare ad un approccio TH stile Intel, almeno sulla teoria che un modulo non possa condividere i dati sulla sua L2 al modulo successivo perchè sarebbe necessario passare per la L3. La mia teoria è che in Intel (a grandi linee) il TH aggiuntivo venga gestito a core tramite una L1 veramente piccola (questo perchè suppongo che debba essere svuotata (se non con pipeline aggiuntive) e veloce, perchè i 2 TH non possono coesistere nello stesso tempo), ed è chiaro che Intel ha avuto (e necessitato) di anni per metterlo a puntino. L'approccio AMD potrebbe essere una sorta di TH aggiuntivo ma non gestito da 1 core ma utilizzando il core libero nello stesso modulo (quando non occupato o comunque non occupato al 100%) perchè in fin dei conti è come se fosse una replica del TH logico di Intel ma fisico su 2 core. E' chiaro che l'approccio Intel garantisca una potenza superiore nel caso che tutti i core siano occupati, ma teoricamente il TH di AMD sarebbe fisico e non logico, e dovrebbe garantire prestazioni superiori con una applicazione ST, semplicemente perchè si baserebbe su 2 L1 distinte e su pipeline altrettanto distinte, senza obbligo di loop a vuoto per svuotarle. Del resto... un approccio stile Intel sarebbe possibile unicamente accorciando la lunghezza delle pipeline al minimo indispensabile, appunto perchè più è lunga e più sono lunghi i cicli per svuotarla... e non mi sembra che le info su AMD circa Zen siano mirate a questo... sia più funzionale
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18-05-2015, 15:10 | #29414 | |
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Mi lascia perplesso comunque tutto ciò. .. perché avere una architettura più simile ad Intel (e quindi difficilmente superiore e ottimisticamente alla pari, tutto ricadrebbe sul silicio e sull'evoluzione di esso. Cioè... abbiamo visto che Intel si può permettere di realizzare X varianti della stessa architettura (die nativi X4, X8 e maggiore di X8) e di queste variati affinare un PP silicio esclusivo, a seconda se maggiori prestazioni o minor consumo. AMD questo non lo può né fare né avere, quindi quali chance potrà mai avere? Se io non posso competere con lo stesso sistema, mi pare ovvio che la soluzione (che abbia successo o meno), sia in una alternativa... quindi io supporrei che per quanto possa implementare AMD con Zen, comunque non può copiare le caratteristiche di Intel perchè avrebbe già perso in partenza. E poi mi sembra assurdo che lo si faccia proprio quando le caratteristiche di architettura Intel e silicio dimostrino dei limiti che qualcosa comunque va cambiato. Cioè... finchè il numero di core non è alto (e questo è imposto dal silicio), allora grandezza di L3, aggiunta di L4 e qualsivoglia avrebbe un impatto minimo... ma se ipotizziamo un 14nm o ancor più, quindi con un silicio che per 130W TDP potrebbe essere 16 core e più, cacchio... cache inclusiva e quant'altro avrebbero dimensioni importanti... e commercialmente AMD, rimanendo in cache esclusiva, potrebbe comunque realizzare una alternativa perchè a priori avrebbe un numero di transistor ben inferiore, che poi sia planare e non 3D, va sempre considerato che a parità di bontà PP, la possibilità di proci fallati è proporzionale al numero di transistor.
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18-05-2015, 21:31 | #29415 | |
Bannato
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Ci deve essere un'errore però nella news. Perché i power 8 sono già in produzione e usano già i 22 PD-SOI, penso che questo sia uno sviluppo di questo pp di ibm volto a migliorare costi e prestazioni in modo da offrire a ibm in primis un pp migliore per i prossimi power n che potrebbero essere power8+ e power9 come già successo con il power 7 su 45 SOI e power 7+ su 32 soi. Ultima modifica di Mister D : 18-05-2015 alle 21:36. |
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19-05-2015, 08:13 | #29416 |
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19-05-2015, 21:31 | #29417 | |
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19-05-2015, 23:07 | #29418 |
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Io aspetto che AMD tolga completamente il veto sulle caratteristiche di ZEN, forse anche in questo caso c'entra il processo produttivo, che sia quello di Samsung oppure quello di TSMC; sono più che sicuro che non siano i 22nm IBM...
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20-05-2015, 09:37 | #29419 | |
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20-05-2015, 09:59 | #29420 |
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Comunque alla fine la scelta ricadra presumibilmente sul silicio il cui mix sarà nel costo/leakage/frequenze in reazione agli obiettivi. Cioè, se come obiettivo ha un profilo server, quindi con alto numero di core e quindi di transistor, risulterebbe più importante avere il più basso leakage che 200MHz di frequenza in più a favore magari di 2 core in più a die.
Comunque... a me pare che una idea sul silicio l'abbiano già. .. perché altrimenti avrebbero realizzato un APU che tutto sommato a 4 o 6 core sarebbe realizzabile con qualsiasi PP basato sotto i 20nm... tirare fuori Zen server/desktop indubbiamente non lo si può fare senza una base silicio idonea.... e non penso, dopo l'esperienza 32nm SOI, solamente sull'aspettativa.
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