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HP Elitebook Ultra G1i 14 è il notebook compatto, potente e robusto
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Old 20-12-2006, 12:28   #1
Redazione di Hardware Upg
www.hwupgrade.it
 
Iscritto dal: Jul 2001
Messaggi: 75173
Link alla notizia: http://www.hwupgrade.it/news/memorie/19610.html

NEC, Elpida e OKI collaborano allo sviluppo di una nuova modalità per il packaging dei chip di memoria, che permette di impilare fino a otto chip ed un controller

Click sul link per visualizzare la notizia.
Redazione di Hardware Upg è offline   Rispondi citando il messaggio o parte di esso
Old 20-12-2006, 13:03   #2
Tombolo
Bannato
 
Iscritto dal: Dec 2006
Messaggi: 21
interessante...
Tombolo è offline   Rispondi citando il messaggio o parte di esso
Old 20-12-2006, 14:04   #3
demon77
Senior Member
 
L'Avatar di demon77
 
Iscritto dal: Sep 2001
Città: Saronno (VA)
Messaggi: 21713
bello!
memorie piccolissime a densità molto elevate!
demon77 è offline   Rispondi citando il messaggio o parte di esso
Old 20-12-2006, 16:39   #4
Octane
Senior Member
 
L'Avatar di Octane
 
Iscritto dal: Mar 2002
Città: Treviso
Messaggi: 911
somiglia in parte alla tecnologia "proximity" sviluppata un po' di tempo fa da SUN.
In quel caso l'utilizzo e' per connessioni ad alta velocita' e bassa latenza tra vari die adiacenti (intesi come pezzi di silicio, non necessariamente core omogenei)
per chi fosse interessato:
http://www.aceshardware.com/read_news.jsp?id=75000448
http://www.aceshardware.com/read_news.jsp?id=80000585

Ultima modifica di Octane : 20-12-2006 alle 16:48. Motivo: aggiunti links
Octane è offline   Rispondi citando il messaggio o parte di esso
Old 21-12-2006, 14:51   #5
Michelangelo_C
Senior Member
 
L'Avatar di Michelangelo_C
 
Iscritto dal: Feb 2005
Città: Firenze
Messaggi: 1207
1000 pin per ciascun lato.. cosa si intende per lato? Forse faccia superiore e inferiore del chip? Mi immagino una pina di chip memoria che si incastrano uno sull'altro come una cpu nel suo socket, sbaglio?

Il vantaggio starebbe appunto nel fatto che le connessioni tra i chip sono dirette, dal pin di quella sopra alla cunetta di quella sotto ci sono solo 50 micron, invece di un filamento di qualche centinaio di micron (con conseguente caduta maggiore e maggior consumo, anche se credo si parli di pochissimi mW).
Michelangelo_C è offline   Rispondi citando il messaggio o parte di esso
Old 21-12-2006, 14:58   #6
Michelangelo_C
Senior Member
 
L'Avatar di Michelangelo_C
 
Iscritto dal: Feb 2005
Città: Firenze
Messaggi: 1207
Altre sue domande per chi sa rispondere:

1) Quanti strati si riesce ad impilare in una microSD attuale (da 1 o 2 GB)? Giusto per capire a che capacità potrebbero arrivare con 8 strati.

2) Perchè poi servirebbero ben 1000 contatti per chip di memoria per realizzare la pila? Forse perchè i chip si trovano connessi in serie e vogliamo poter accedere a ciascuno di essi in modo immediato?
Michelangelo_C è offline   Rispondi citando il messaggio o parte di esso
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