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#201 |
Senior Member
Iscritto dal: Jan 2003
Messaggi: 10395
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Si, ma non sono stadi inseriti "nella" pipeline in senso classico. Comunque il mio post era solo per dire che la instruction cache del P4 non è quantificabile correttamente in termini "normali".
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PC Specialist Recoil 17 - 13900HX - 32 GB DDR5 5200 - Geforce RTX 4080 Mobile 12Gb 175W - 1 SSD Corsair Core XT MP600 2 TB NVMe - 1SSD Solidigm P41+ 2TB NVMe |
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#202 | ||
Senior Member
Iscritto dal: Jan 2002
Città: Germania
Messaggi: 26110
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Quote:
Qui la cosa è un po' anomala perché questi stadi vengono inseriti prima di tutti quanti gli altri. Quote:
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Per iniziare a programmare c'è solo Python con questo o quest'altro (più avanzato) libro @LinkedIn Non parlo in alcun modo a nome dell'azienda per la quale lavoro Ho poco tempo per frequentare il forum; eventualmente, contattatemi in PVT o nel mio sito. Fanboys |
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#203 |
Senior Member
Iscritto dal: Jan 2003
Messaggi: 10395
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[quote]Originariamente inviato da cdimauro
Considera che la pipeline classica non è propriamente a lunghezza fissa, ma i vari stadi cambiando ed eventualmente se ne aggiungono altri a seconda del tipo di istruzione che viene elaborata, e anche se c'è da fare un write-back nella cache L2. Qui la cosa è un po' anomala perché questi stadi vengono inseriti prima di tutti quanti gli altri. Infatti, anche se più che altro è l'execution stage che "cambia lunghezza" a seconda dell'istruzione ![]()
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#204 |
Senior Member
Iscritto dal: Dec 2004
Città: Milano
Messaggi: 354
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Ma allora sti nuovi pentium 6xx saranno compatibili con il chipset 925XE (quello della Asus P5AD2-E per intenderci) ??
Ho cercato dappertutto ma anche sul sito della intel dice che il 925x sarà compatibile ma non parla del 925xe Devo cambiare pc a breve ma se tra 4 meso volessi ri-uppare il processore e non posso montare un EM64T perchè ho la 925XE è una bella fregatura... qualcuno ne sa qualcosa? grazie |
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