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DS N°7 E-Tense: il SUV premium made in Melfi che punta su autonomia e comfort
DS N°7 E-Tense: il SUV premium made in Melfi che punta su autonomia e comfort
Fino a 740 km WLTP con la batteria da 97,2 kWh, sospensioni che leggono la strada con una telecamera e un abitacolo da salotto parigino. La nuova DS N°7 raccoglie l'eredità della DS 7 e la porta, per la prima volta, nel mondo 100% elettrico. Ecco come è fatta, cosa offre e quanto costa.
Recensione Samsung Galaxy Tab S12 Ultra: non chiamatelo tablet... è molto di più
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Abbiamo provato Samsung Galaxy Tab S12 Ultra nella versione 12 GB + 256 GB con tastiera, e il risultato è un tablet che in questa configurazione si comporta come un notebook con la fluidità tipica di Android. Spessore di 5,1 mm, display Dynamic AMOLED 2X da 14,6 pollici, MediaTek Dimensity 9500 e un software senza incertezze compongono un prodotto di vertice, con prezzi da 1.539 euro, frenato solo da un'autonomia nella parte bassa del confronto
Hyundai IONIQ 5 N, l'elettrica che finge di essere termica (e ci riesce da paura)
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Abbiamo provato per dieci giorni la Hyundai IONIQ 5 N, con 650 CV, 770 Nm e uno 0-100 km/h in 3,4 secondi. Il suo punto forte è N e-Shift, che simula un cambio a otto rapporti con suoni da motore termico e perfino un bang supersonico
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Old 13-03-2007, 17:26   #1
franksisca
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Implementazione hardware della cache

ragazzi, chi mi dà un modello implementativo di una cache reale???

mi serve sia schema circuitale che concettuale.......mi sapreste dare una mano???
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Old 13-03-2007, 17:37   #2
PGI-Bis
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Il capitolo 5 di Computer Architecture A quantitative approach è per lo più dedicato alla cache. A p. 403 e 483 (3a ed) c'è lo schema logico dell'Alpha 21264.

Per i circuiti, passo...
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Uilliam Scecspir ti fa un baffo? Gioffri Cioser era uno straccione? E allora blogga anche tu, in inglese come me!
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Old 13-03-2007, 17:39   #3
franksisca
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Il capitolo 5 di Computer Architecture A quantitative approach è per lo più dedicato alla cache. A p. 403 e 483 (3a ed) c'è lo schema logico dell'Alpha 21264.

Per i circuiti, passo...
domani vado a prenderlo dal prof. (in italiano).....cercavo qualcosa in rete.
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Old 17-03-2007, 22:47   #4
franksisca
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domani vado a prenderlo dal prof. (in italiano).....cercavo qualcosa in rete.
materiale elettronico non riuscite a consigliarmelo????


poi, una domanda, meglio una cache a 32Kb o 256 registri a 64 bit???


perchè una rispetto all'altra???


io penso meglio la cache rispetto ai registri, costa di meno, le prestazioni minori non minano la velocità del mio progetto.

secondo voi???
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Old 18-03-2007, 12:07   #5
MEMon
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Ma qual'è il progetto?
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Old 18-03-2007, 12:54   #6
franksisca
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Ma qual'è il progetto?
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Old 18-03-2007, 13:19   #7
^TiGeRShArK^
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materiale elettronico non riuscite a consigliarmelo????


poi, una domanda, meglio una cache a 32Kb o 256 registri a 64 bit???


perchè una rispetto all'altra???


io penso meglio la cache rispetto ai registri, costa di meno, le prestazioni minori non minano la velocità del mio progetto.

secondo voi???
dipende da quello che ci devi fare.
Se i dati che stai analizzando entrano TUTTI nei 256 registri a 64 bit e hai quindi bisogno di caricarli solo la prima volta....bhè... indubbiamente meglio i registri .
Altrimenti in generale un numero minore di registri e una cache sono la soluzione ottimale.
Basta vedere ormai l'evoluzione attuale dei processori.
Ai tempi della SPARC vi erano 32 registri General Purpose.
C'è da dire che generalmente di questi 32 solo 8 erano effettivamente utilizzabili per ogni processo a causa del meccanismo delle sliding windows implementato x effettuare l'equivalente del context switching
Cmq dopo tutte queste vacue parole..
Trova il giusto compromesso.
Un numero adeguato di registri e la maggior dimensione possibile della cache compatibile con quel numero di registri.
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Old 18-03-2007, 14:08   #8
franksisca
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dipende da quello che ci devi fare.
Se i dati che stai analizzando entrano TUTTI nei 256 registri a 64 bit e hai quindi bisogno di caricarli solo la prima volta....bhè... indubbiamente meglio i registri .
Altrimenti in generale un numero minore di registri e una cache sono la soluzione ottimale.
Basta vedere ormai l'evoluzione attuale dei processori.
Ai tempi della SPARC vi erano 32 registri General Purpose.
C'è da dire che generalmente di questi 32 solo 8 erano effettivamente utilizzabili per ogni processo a causa del meccanismo delle sliding windows implementato x effettuare l'equivalente del context switching
Cmq dopo tutte queste vacue parole..
Trova il giusto compromesso.
Un numero adeguato di registri e la maggior dimensione possibile della cache compatibile con quel numero di registri.
infatti, avendo studiato anche la sparc, e conoscendo i costi di queste macchine, mi era venuto il dubbio che una implementazione a registri costasse troppo per un semplice firewall.

comunque si, secondo i miei calcoli 256 registri dovrebbero bastare.
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