Via Apollo MVP3

Via Apollo MVP3

Analisi tecnica del chipset Via Apollo MVP3

di pubblicato il nel canale Schede Madri e chipset
 

Via Apollo MVP3

Struttura Chipset N° chip 2
  Tipologia 1 BGA da 476 pin, 1 QFP da 208 pin
Gestione memoria Tipologia cache L2 Sincrona (pipeline Burst)
  Dimensione max Cache L2 2 MB
  Memoria max supportata 1 GB
  Memoria max cacheable da 128 a 512 MB
  Supporto ECC Si
  Tipi di memoria supportata FP/EDO/SDRAM/SDRAM II
Gestione Cpu N° cpu gestibili 1
  Supporto cpu Intel Pentium, Pentium MMX
  Supporto cpu AMD K5, K6, K6-2
  Supporto cpu Cyrix M1, M2
Supporto USB Si
  AGP Si
  Plug & Play Si
Specifiche PCI Versione PCI 2.1
  Concurrent PCI Si
Power Management  SMM / ACPI Si
  conforme a norme PC97  Si
Controller integrato Nome VT82C586B
  Supporto Bus Master Si
  Supporto Ultra DMA Si
  Transfer rate massimo vedi specifiche UltraDMA (33.3MB/S)
Velocità di bus Ufficialmente supportate 50, 60, 66, 75, 83, 100 MHz
  Non ufficialmente supportate 112 Mhz

Il Mobile VP3 o MVP3 rappresenta da una parte l'evoluzione del progetto Via VP3, dall'altra un prodotto innovativo in quanto, assieme all'Ali Alladin V, è il primo chipset destinato specificamente alle motherboard Super 7. L'MVP3 vanta due caratteristiche principali:

  • possibilità di bloccare la frequenza di lavoro della memoria a 66 Mhz quando quella di bus è a 100 Mhz: è pertanto possibile impiegare memorie che non rispettino le specifiche PC100, addirittura le memorie Simm Edo o Fast Page, quando si utilizza il bus a 100 Mhz, con una limitata perdita di prestazioni rispetto all'impiego di memorie a 100 Mhz;

  • supporto fino a 2 Mbyte di memoria cache L2: la cacheable area del chipset MVP3 è variabile da 128 a 512 Mbyte, a seconda che il quantitativo di memoria cache L2 installato sia pari a 512, 1024 o 2048 Kbyte.
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